《表3 相位噪声表：一种基于ADF4360-9和FPGA的合成时钟源设计》
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《一种基于ADF4360-9和FPGA的合成时钟源设计》
dBc/Hz
用ADI公司的仿真软件ADIsimPLL对ADF4360-9锁相环芯片进行VCO频率为300MHz，DIVOUT输出为150MHz的仿真，得到系统的相位噪声如表3所示。从表3可看出，总相位噪声在偏离中心频率10kHz时为-84.7dBc/Hz，在偏离中心频率100kHz时为-92.2dBc/Hz。
| 图表编号 | XD0060740600 严禁用于非法目的 |
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| 绘制时间 | 2019.06.25 |
| 作者 | 陈杨梦、张伟昆 |
| 绘制单位 | 桂林电子科技大学电子工程与自动化学院、桂林电子科技大学电子工程与自动化学院、中国人民解放军91872部队 |
| 更多格式 | 高清、无水印（增值服务） |
