《表2 输入自由度与性能改变的平均百分比》

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《基于VPR的FPGA架构建模研究》

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1）如表2所示，在输入自由度为0.05时，该组数据较为特殊，通道宽度和线长总和远远高于其他。因为当输入自由度过小时，为了布通则需要较多的通道宽度，否则各个模块会相互竞争布线资源，导致布线失败，所以现实中很少把自由度设定太小。