《表1 IPPD结构与文献[9]结构的FPGA资源对比Tab.1 Comparing FPGA of the IPPD structure's utilization with the st

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《1 Gbit/s QC-LDPC码译码结构的设计》


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基于IEEE802.16e中码长为864、码率为0.5的不规则准循环双对角奇偶校验码，采用IPPD结构与文献[9]的结构，所需FPGA硬件资源如表1所示。从表1可看出，IPPD结构的迭代时间是文献[9]结构的1/6，但加法器和比较器硬件资源的占用是文献[9]结构的6倍。

图表编号XD0020846000    严禁用于非法目的
绘制时间2018.04.25
作者黄志成、陈紫强、谢跃雷、李亚云
绘制单位桂林电子科技大学认知无线电与信息处理省部共建教育部重点实验室、桂林电子科技大学认知无线电与信息处理省部共建教育部重点实验室、桂林电子科技大学认知无线电与信息处理省部共建教育部重点实验室、桂林电子科技大学认知无线电与信息处理省部共建教育部重点实验室
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