《表3 资源使用情况对比：基于FPGA的LDPC编译码的高速并行化设计与实现》
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《基于FPGA的LDPC编译码的高速并行化设计与实现》
同时，本文对3种并行化实现方式的结果进行对比，如表3和表4所示。
| 图表编号 | XD00226484700 严禁用于非法目的 |
|---|---|
| 绘制时间 | 2020.10.10 |
| 作者 | 吴文俊、张锐、程敏敏 |
| 绘制单位 | 中国电科第五十研究所、中国电科第五十研究所、中国电科第五十研究所 |
| 更多格式 | 高清、无水印（增值服务） |
