《表1 FPGA配置模式Tab.1 The configuration mode of FPGA》
提示:宽带有限、当前游客访问压缩模式
本系列图表出处文件名:随高清版一同展现
《基于V93000的现场可编程门阵列测试时间优化方法》
基于自动测试设备(Automatic test equipment,ATE)对FPGA进行测试时,加载测试配置时间往往是加测试向量时间的数百倍,因而对配置模式的选择尤其重要.如表1所示:FPGA配置模式主要分为主串、从串、主并、从并模式和边界扫描模式.本文选择从并配置模式进行FP-GA配置,这是因为从模式的时钟CCLK可同时从外部提供,对下载时序的要求比主模式简单得多,而且并行模式可以使用D0~D31数据位并行下载,节省时间.
图表编号 | XD0029354500 严禁用于非法目的 |
---|---|
绘制时间 | 2019.02.28 |
作者 | 解维坤 |
绘制单位 | 江南大学物联网工程学院、中国电子科技集团公司第五十八研究所 |
更多格式 | 高清、无水印(增值服务) |