《表2 综合实现后的资源占用情况》
使用Xilinx公司Vivado2015.4平台和Virtex-7(xc7vx485tffg1761-2)系列产品开展基于异步电路设计的RSA算法加密芯片的设计和仿真验证。本设计为1024bit明文加密。M,e,N位宽的上限是1024位。本设计的电路结构主要分为四大部分:实现模幂功能的一级异步模块LR_module(MEMODN_1024BIT);实现模乘功能的二级异步模块Montgeory_moudle(ABMODN_1024BIT);实现电路内部乘法、加法运算的功能模块MUL_64BIT、ADD_64BIT和ADD_128BIT以及一些其它功能模块(都系统自动生成RTL级电路),比如具有选择功能的选择器(MUX)、移位功能的异步移位寄存器(shift)、存储功能的寄存器(register)、计数工程的异步计数器。资源占用情况见表2,系统结构的层次化框架如图7所示。
图表编号 | XD0040526700 严禁用于非法目的 |
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绘制时间 | 2019.04.16 |
作者 | 何安平、郭慧波、冯志华、吴尽昭 |
绘制单位 | 兰州大学信息科学与工程学院、广西民族大学广西混杂计算与集成电路设计分析重点实验室、北京计算机技术及应用研究所、广西民族大学广西混杂计算与集成电路设计分析重点实验室 |
更多格式 | 高清、无水印(增值服务) |