《表2 3种运算结构的速度和资源占用情况对比》
将本文提出的Sp MV专用加速器结构与传统运算结构和文献[5]中的EIE运算结构都用verilog实现,综合后得出的速度和资源占用情况对比如表2所示.可以看出,在相同的FPGA上,本文设计的基于矩阵列向量线性组合的加速器结构与传统运算结构相比,速度能够提高28%,资源占用率减少约48%;与文献[5]中的EIE运算结构相比,速度能够提高37%,资源占用率减少约18%.
图表编号 | XD00213659000 严禁用于非法目的 |
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绘制时间 | 2021.03.01 |
作者 | 邓军勇、马青青 |
绘制单位 | 西安邮电大学电子工程学院、西安邮电大学电子工程学院 |
更多格式 | 高清、无水印(增值服务) |