《表1 FPGA逻辑资源消耗》
本算例中交流系统等效为交流电压源,因此每个子网的矩阵规模较小,矩阵求解时间较短,本算例矩阵求解时间为2.61μs。根据本算例电路特点,在使用动态组合模型时,MMC1与MMC3采用等效电路模型,MMC2则采用动态组合模型,并复用MMC1的计算模块,即表1中的方案1。当系统规模较大,矩阵计算时间所占每步长计算总时间比例较大,则可以仅对MMC1使用等效电路模型,MMC2与MMC3采用动态组合模型,即表1中的方案2。表1为等效电路模型计算模块与平均值计算模块在FPGA中的计算资源消耗情况,这些资源主要包括DSP单元,触发器(Flip-Flop,FF),查表单元(Look-Up Table,LUT)。单个计算模块用于一个桥臂计算,每个MMC中6个桥臂的计算以串行方式复用该模块。其中等效电路模型计算模块完成一个桥臂耗时0.55μs,即整个MMC需3.3μs。采用方案1时,硬件资源可节约32%左右,采用方案2时,硬件资源可节约66%左右。本算例实时仿真设计基于方案1实现。
图表编号 | XD00186669200 严禁用于非法目的 |
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绘制时间 | 2020.10.23 |
作者 | 沈卓轩、郭琦、姜齐荣、郭海平、张树卿、于思奇、李笑倩 |
绘制单位 | 电力系统及发电设备控制和仿真国家重点实验室清华大学、直流输电技术国家重点实验室南方电网科学研究院有限责任公司、直流输电技术国家重点实验室南方电网科学研究院有限责任公司、广东省新能源电力系统智能运行与控制企业重点实验室、电力系统及发电设备控制和仿真国家重点实验室清华大学、直流输电技术国家重点实验室南方电网科学研究院有限责任公司、广东省新能源电力系统智能运行与控制企业重点实验室、电力系统及发电设备控制和仿真国家重点实验室清华大学、电力系统及发电设备控制和仿真国家重点实验室清华大学、电力系统及发电设备控制和仿真 |
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