《表1 异构体系中模块分配列表》
芯片内部SPARC CPU是AXI总线上的主设备;AI协处理单元作为也是AXI总线上的主设备,可以读写任何从设备的数据,但同时受CPU内核控制。总线上的从设备为:片内外设、片上存储器、片外存储器、片外IO等,这些从设备统一编址,被各处理器核心平等共享。总线控制器负责对总线访问进行仲裁和管理,仲裁管理逻辑和算法包括:固定优先、总线锁定、定时释放等。可通过对寄存器的设置选择仲裁管理逻辑和算法。
图表编号 | XD00161373100 严禁用于非法目的 |
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绘制时间 | 2020.04.01 |
作者 | 颜军、唐芳福、张志国、韩俊、龚永红 |
绘制单位 | 珠海欧比特宇航科技股份有限公司、珠海欧比特宇航科技股份有限公司、珠海欧比特宇航科技股份有限公司、珠海欧比特宇航科技股份有限公司、珠海欧比特宇航科技股份有限公司 |
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