《表1 视频图像数据包缓冲区排序原则》

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《基于CPLD芯片控制的视频图像处理系统设计》

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对于待处理视频图像信息，由CPLD芯片控制的硬件处理结构始终维持按序发送的执行状态，但信息码流的发送只能以数据包作为单位结构组织，对于数据包不设置独立的传输途径，每个信息结构可经过不同子窗口的转发进入系统处理接收端，在经过VGA显示模块的传输后，接收端元件并不能保证数据信息依然维持原始发送顺序，因此为了实现视频图像数据的同步传输，必须在数据包缓冲区域内，对信息参量实施必要排序处理[13]。在执行视频图像数据包的物理排序时，应以一个随机生成的16位二进制数作为发送序列号，接下来每发出一个图像数据信息，就在起始序列号的基础上加“1”，当序列号的末尾标注数值超过16位二进制数的应用范围时，则建立一个全新的序列号组织[14]。采用双向循环链表准则，设原始信息参量为“Seq0”，插入指令为“add”，联立16位随机编码标准，对视频图像数据包的缓冲区排序原则进行归纳，如表1所示。