《表1 Modelsim仿真计算时间测试结果比较》
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《基于FPGA的32位多并行2DFFT处理器的设计》
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本系统的仿真计算时间测试结果如表1所示.
图表编号 | XD00131743700 严禁用于非法目的 |
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绘制时间 | 2020.03.01 |
作者 | 毛宇河、伍松 |
绘制单位 | 广西科技大学机械与交通工程学院、广西汽车零部件与整车技术重点实验室(广西科技大学)、广西科技大学机械与交通工程学院、广西汽车零部件与整车技术重点实验室(广西科技大学) |
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