《表2 采用CBF预计算时视频序列的吞吐率变化情况》

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《HEVC熵编码硬件设计与残差编码吞吐率优化》

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表3为本文设计在SMIC 90nm工艺下综合的结果，以及与其他论文的比较。文献[3]对残差编码中上下文模型的选择算法提出了改进；文献[4]也采用了基于流水线的残差编码和并行的算术编码模块。本文设计架构完整包含了熵编码所有模块，提出的基于残差的CBF的吞吐率优化方法可以在增加少量资源消耗的情况下提高吞吐率。本设计中实现200MHz以上的时钟频率，对1080p视频在30fps的帧率下进行实时编码。