《表1 支路开关信号真值表》

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《一种超大摆幅5 Gb/s PAM4发射器设计》

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译码器输入为2 bit的并行信号，译码输出为3路开关信号。以2 bit信号的4种状态为输入，经译码控制3条电流支路的通断，控制输出的4个电平值。其逻辑结构由电路真值表决定，如表1所示。