《表2 异构多核处理平台配置》

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《基于机器学习的异构感知多核调度方法》

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由于本文主要针对单指令集架构下的异构多核平台，即同一平台下的多个处理核具有相同的指令集架构但各自有不同的微架构（如处理器主频、流水线深度、缓存系统差异等）的处理核，因此在本次实验中，本文基于Sniper搭建了一个由大核和小核两种类型的处理核组成的异构多核平台，其中大核指微架构的实现更加复杂，性能更高的处理核，而小核指的是微架构的实现相对简单，功耗较低的处理核。该平台是一个典型的四核异构非对称多核处理器，由1个大核和3个小核组成，详细配置如表2所示。1大3小的四核架构是移动平台领域常见的处理器配置方式：1个主打高性能的大核能在可接受面积和功耗的前提下提供最高的单核性能，而3个小核则可以在做到在更小的面积和功耗下提供一定的多核性能，从而在多个常见场景下拥有性能和功耗的优势。此外，由于cache大小、时钟频率等参数既影响程序的性能执行结果又影响了资源争用和线程同步等情况，为了精确验证程序在不同核心上执行的性能差异原因，本文采用了相同的时钟频率和三级cache缓存架构，其中L1 Cache为256 KB，L2 Cache为512 KB，共享的L3 Cache大小设置为8 MB。大核和小核的指令集架构均基于Intel Nehalem x86架构，且处理核的主频均为2.66 GHz。在核心的微架构配置上，本文为大核和小核均设置了大小为4的发射宽度，但是大核拥有128的指令窗口大小和长度为48的读取队列，与之对应的小核的指令窗口大小和队列长度分别为16和6。