《表3 资源利用情况Table 3 Resource utilization》

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《基于System Generator的简化粒子滤波算法设计及硬件实现》

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用Sys Gen模块转换上述结构为HDL后，对整个设计进行综合及编译，并在Xilinx Zynq-7000（7z020 clg484-1）上实现完整的纯方位跟踪简化粒子滤波算法。表3所示为使用2048个粒子，基于简化粒子滤波算法，在FPGA上综合后各资源的占用情况。