《表1 预处理模式的性能提升比率》

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《多核并行访问纹理单元的预处理方法》

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采用System verilog进行建模，在VCS平台仿真，时钟频率为100MHz，测试数据2048个，每个SP对应16*16的像素块，处理256个数据，不同测试集下预处理方法的速率提升结果如表1所示。