《表3 第2层带权输入Z0～Z29理论值和实际输出值》

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《基于FPGA的BP神经网络识别系统设计》

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本设计使用MNIST数据集的测试数据，获得一个手写数字1的样本像素数据X，按照算法公式，手工计算出第2层和第3层的带权输入Z和激活值，与基于FPGA设计的硬件BP神经网络设计判别系统处理的数据进行比较[19]，结果近似相等。其中，第2层带权输入Z0～Z29理论值和实际输出值如表3所示，第3层带权输入Z0～Z9理论值和实际输出值如表4所示。