《表3 多时钟方式实现多时钟域测试》

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《基于V93k的多时钟域集成电路测试技术研究》

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如表3所示，通过使用多端口特性，3个端口可以设定不同的测试频率，每一个端口都有1个测试周期，但是，由于机台硬件约束，主时钟不能超过硬件的最大约束要求，对小头的测试ATE，V93k支持最大4个主时钟（即CLK1、CLK3、CLK2和CLK8），但由于绝大部分测试机台会将CLK8所处的Group8配置为模拟通道，因此CLK8不能用作数字主时钟，也就是最多可用3个主时钟。