《表1 执行时间对比：可重构视频阵列处理器测试平台设计与实现》

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《可重构视频阵列处理器测试平台设计与实现》

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为满足不同测试序列的更换需求，分别以标准测试序列akiyo＿qcif＿176×144.yuv、carphone144×176.yuv、foreman＿qcif.yuv和highway＿qcif.yuv为例测试H.265/HEVC中算法映射的可行性。如图12所示为测试结果，其中，图12（a）和图12（b）分别为akiyo＿qcif＿176×144.yuv测试序列的软件测试结果和可重构视频阵列处理器测试结果；图12（c）和图12（d）为carphone144×176.yuv序列的测试结果；图12（e）和图12（f）为foreman＿qcif.yuv序列的测试结果；图12（g）和图12（h）为highway＿qcif.yuv序列的测试结果；可以看出平台重构的图12（b）、图12（d）、图12（f）和图12（h）图的质量远远优于软件测试的图12（a）、图12（c）、图12（e）和图12（g）图。在软件上执行上述测试序列帧内帧间各一帧，需要12.732 s，在该平台上需要49320000周期，根据硬件频率100 MHz，总共用时0.493 2 s，执行时间如表1所示。