《表1 DSLogic性能参数表》

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《接口时序一致性连续定量监测技术研究》


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本文基于虚拟逻辑分析仪结构设计时序监测的硬件系统,如图2所示;利用DSLogic逻辑分析仪模块实现接口信号数据采集及阈值比较,其性能参数如表1所示;通过USB总线接收数据流并以二进制文件存储到服务器硬盘。