《表1 传统除法器与本文中除法器硬件消耗对比》

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《误差提取自适应修正的前馈式TIADC校准算法》

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式中:B[n]为LMS的收敛值；μ为收敛的步长。该除法器的实现虽然基于LMS的反馈环路实现，但该反馈环路较小，且输入变量易于控制，并不存在稳定性的问题。均采用20 bit运算精度，将传统除法器与本文设计的除法器硬件消耗对比如表1所示，可以看出本文除法器设计的硬件消耗远小于传统除法器。