《表6 设计对比:基于RISC-V浮点指令集FPU的研究与设计》
文献[7]FPVC的浮点性能为25 MFLOPS,文献[10]Calm RISC32的系统频率为70 MHz。本设计采用连续流水线结构,在FPGA上实现了100 MHz的单精度频率。因此,如果在每个时钟周期连续提供输入,则本设计在FPGA上将提供高达150 MFLOPS的吞吐量。设计对比如表6所示。
图表编号 | XD00201505000 严禁用于非法目的 |
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绘制时间 | 2021.02.01 |
作者 | 潘树朋、刘有耀、焦继业、李昭 |
绘制单位 | 西安邮电大学电子工程学院、西安邮电大学电子工程学院、西安邮电大学计算机学院、西安邮电大学电子工程学院 |
更多格式 | 高清、无水印(增值服务) |