《表2 DDC主要测试参数配置信息》

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《基于FPGA的磁共振接收机数字下变频设计》

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针对系统变带宽抽取性能的测试，仿真时系统采用100MHz时钟主频，测试信号使用采样率为100MHz，中心频率为63.8MHz，带宽分别为2kHz与200kHz的矩形脉冲。由带通采样定理可知，测试信号经过采样后，镜像信号折叠至36.2MHz处，如图8（b）、图10（b）所示。仿真时，首先利用MATLAB按照表2中的配置信息分别生成两组配置参数文件，再利用ModelSim加载测试信号与参数文件对Verilog代码进行RTL功能仿真，最后将仿真输出结果写入文件供MATLAB调用分析。