《表5 相邻PAD点绝缘电阻测试结果》
由于金键合面和下层金属引线仅靠一层PECVD沉积的氧化层绝缘,在金硅键合过程中施加在晶圆上的压力可能会破坏该氧化层,金渗透到下层金属引线上,从而导致相邻引线的短路。因此,需要对芯片的相邻PAD点进行电学性能测试,判断键合是否对金属引线产生不利影响。刻蚀PAD点上方的结构层晶圆露出PAD点,200倍光学显微镜下观察露出的B1芯片的PAD点,如图5所示。测量相邻电绝缘PAD点的绝缘性,结果如表5所示,电压为0~10 V时,绝缘电阻均大于7 GΩ,表明绝缘性良好,未受金硅键合影响。
图表编号 | XD0028233400 严禁用于非法目的 |
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绘制时间 | 2019.03.15 |
作者 | 王帆、刘磊、张胜兵、刘阳 |
绘制单位 | 华东光电集成器件研究所、华东光电集成器件研究所、华东光电集成器件研究所、华东光电集成器件研究所 |
更多格式 | 高清、无水印(增值服务) |