《表1 FPGA资源利用情况》
本文中FPGA实现均采用Verilog语言描述,以及Xilinx的ISE 14.7对设计模块进行综合、映射、布局和布线后,占用FPGA的主要资源如表1所示,本设计以较少的资源完成了多通道视频数据的合成处理,有利于整个系统的成本控制。最后将生成的FPGA烧写文件下载到由xc7k325t-2fbg676及该国产图像传感器搭建的硬件电路中,通过cameralink采集卡获得最终合成的视频数据,如图5所示,视频分辨率为2048*1152,帧频为30Hz,且图像完整、流畅。
图表编号 | XD0043153600 严禁用于非法目的 |
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绘制时间 | 2019.03.05 |
作者 | 胡佳文 |
绘制单位 | 洛阳电光设备研究所 |
更多格式 | 高清、无水印(增值服务) |