《表3 FPGA加速器性能对比》
加速器IP核使用Vivado HLS工具实现,在Xilinx ZC706开发板上进行板级验证,其验证结果如图15所示。表3为本文FPGA加速器与其他文献的性能对比。
图表编号 | XD00188982100 严禁用于非法目的 |
---|---|
绘制时间 | 2020.11.15 |
作者 | 吴进、张伟华、席萌、代巍 |
绘制单位 | 西安邮电大学电子工程学院、西安邮电大学电子工程学院、西安邮电大学电子工程学院、西安邮电大学电子工程学院 |
更多格式 | 高清、无水印(增值服务) |
加速器IP核使用Vivado HLS工具实现,在Xilinx ZC706开发板上进行板级验证,其验证结果如图15所示。表3为本文FPGA加速器与其他文献的性能对比。
图表编号 | XD00188982100 严禁用于非法目的 |
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绘制时间 | 2020.11.15 |
作者 | 吴进、张伟华、席萌、代巍 |
绘制单位 | 西安邮电大学电子工程学院、西安邮电大学电子工程学院、西安邮电大学电子工程学院、西安邮电大学电子工程学院 |
更多格式 | 高清、无水印(增值服务) |