《表2 定点数转浮点数IP核配置》

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《基于FPGA的数字加速度计设计与实现》

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利用Xilinx浮点数IP核定点数转换为浮点数的功能将16位有符号整数转换为浮点数时，配置IP核如表2所示，定点数的整数部分设置为16位，小数部分设置为0位，输出选择单精度浮点数即可完成转换，并且会自动进行四舍五入。