《表2 FPGA资源使用情况》

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《一种基于HDMI2.0的编解码器设计》

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当HDMI20使能为高电平时，编码器工作在HDMI2.0模式，将传输周期划分为视频数据周期、数据岛周期、加扰控制周期和非加扰控制周期。非加扰控制周期占用8个时钟周期，其他的传输周期与HDMI1.4模式一致。根据表1和表2中的编码方式，分别对不同传输周期的数据进行编码，然后输出3个数据通道的编码数据。