《表2 以铷钟作为TDC工作时钟时拟合修正情况》

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《基于FPGA的TDC系统偏差修正方法的研究》

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对于铷钟来说拟合的直线方程为y=4.78×10-10 x+310，其斜率为4.78×10-10。表2为以铷钟作为TDC工作时钟时的0～1s测量范围内不同待测时间间隔的系统偏差与修正结果的对比，可以看出，通过一次线性拟合其结果同样得到显著改善，此时系统偏差平均值为49ps。整个区间所有测试值的系统偏差拟合后的结果如图9所示。