《表1 英文字母电码符号》

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《数字化等幅报信号设计与实现》

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上位机软件将报文内容依据表1和表2的编码对照表翻译为对应的点划信息通过PCI总线写入FPGA片上RAM存储单元，将载波频率值通过计算产生DDS相位累加值写入到DDS集成IP核输入端口，根据码速计算出RAM输出时钟，再根据时钟分频比写入到时钟控制单元的初始计数值，根据是否添加干扰信号、干扰信号模式（噪声、话音、等幅报等）、调制样式（AM、FM、PSK、QAM等）、幅度参数（相对幅度0d Bc～-50dBc）。FPGA收到上位机启动命令后进行信号发送，可以在发送过程中进行暂停等操作控制。输出信号效果图如图9、图10、图11所示。图9为码速100字/分时信号发生的示波器时域图，满足点划时间计算关系，展开的信号频率也符合30MHz载波频率的设置。图10分别对应3种状态下等幅报信号的频谱图，图11分别对应3种状态下等幅报信号的时域图。从测试的效果看，无干扰时信号可以准确的反馈在频域和时域，-20d B相对功率干扰时频域和时域开始有干扰效果，0d B相对功率干扰时频域和时域均表现为干扰强烈，从接收机解调出的效果可以知道，第一种无干扰状态接收机可以清晰地输出\"滴答（a）答嘀嘀嘀（b）答滴答滴（c）答嘀嘀（d）\"为一组的等幅报信号，内容可以被正常接收并准确识别，第二种状态时\"滴答\"声音依然可以比较清楚的分辨，但是有明显的杂音存在，识别稍有困难，第三种状态下\"滴答\"声音已经无法分辨，无法有效接收信号并识别。