《表1 系统仿真参数配置表》

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《窄带物联网信道接收端检测算法的并行化实现》

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按照可重构阵列处理器的设计原理搭建仿真模型平台，FPGA的时钟为100 MHz，时钟周期为10 ns。在该仿真平台上，对接收端检测算法进行并行化映射，首先按照系统配置的仿真参数进行配置。仿真参数是根据LTE协议的标准制定的，如表1所示。